Texas Instruments LMK04368-EP Ultra-rauscharmer Jitter-Reiniger
Der LMK04368-EP ultra-rauscharme Jitter-Reiniger von Texas Instruments ist ein hochleistungsfähiger Taktkonditionierer mit JEDEC JESD204B/C Unterstützung für Weltraumanwendungen. Die 14 Taktausgänge von PLL2 können so konfiguriert werden, dass sie sieben JESD204B/C Wandler oder andere Logik-Geräte mit SYSREF- oder Gerätetakten ansteuern. SYSREF kann sowohl über AC- als auch über DC-Kopplung bereitgestellt werden. Diese Bauteile sind nicht auf JESD204B/C-Applikationen beschränkt. Jeder der 14 Ausgänge kann individuell als Hochleistungsausgang für traditionelle Taktsysteme konfiguriert werden.
Der LMK04368-EP von Texas Instruments kann für den Betrieb in den Modi Einzel-PLL, Dual-PLL oder Taktverteilung mit oder ohne Reclocking oder SYSREF-Generierung konfiguriert werden. PLL2 kann entweder mit einem externen oder internen VCO arbeiten. Die hohe Leistungsfähigkeit zusammen mit der Fähigkeit zwischen der Stromversorgung und Leistung, den dualen VCOs, der dynamischen digitalen Verzögerung und der störungsfreien analogen Verzögerung einen Ausgleich zu schaffen, machen die Bereitstellung von hochleistungsfähigen Taktbäumen möglich. Die LMK04368-EP Bauteile haben Goldbonddrähte, einen Temperaturbereich von -55 bis +105 °C und eine SnPb-Leitungsfinish.
Merkmale
- Umgebungstemperaturbereich von -55 °C bis 125 °C
- 3.255 MHz maximale Taktausgangsfrequenz
- Multi-Modus (Dual-PLL, Einzel-PLL und Taktverteilung)
- 6 GHz externer VCO oder Verteilungseingang
- Extrem rauscharm, bei 2.500 MHz
- 54 fs RMS Jitter (12 kHz bis 20 MHz)
- 64 fs RMS Jitter (100 Hz bis 20 MHz)
- -157,6 dBc/Hz Grundrauschen
- Extrem rauscharm, bei 3.200 MHz
- 61fs RMS-Jitter (12kHz bis 20MHz)
- 67 fs RMS Jitter (100 Hz bis 100 MHz)
- -156,5 dBc/Hz Grundrauschen
- PLL2
- PLL FOM von -230 dBc/Hz
- PLL 1/f von -128 dBc/Hz
- Phasendetektor-Rate bis zu 320 MHz
- Zwei integrierte VCOs von 2.440 MHz bis 2.600 MHz und 2.945 MHz bis 3.255 MHz
- Bis zu 14 differentielle Gerätetakte
- CML-, LVPECL-, LCPECL-, HSDS-, LVDS- und 2xLVCMOS programmierbare Ausgänge
- Bis zu 1 gepufferter VCXO/XO-Ausgang
- LVPECL, LVDS, 2x LVCMOS programmierbar
- 1-1023 CLKOUT-Teiler
- 1-8191 SYSREF-Teiler
- 25 ps analoge Schrittverzögerung für SYSREF-Takte
- Digitale Verzögerung und dynamische digitale Verzögerung für Gerätetakte und SYSREF
- Holdover-Modus mit PLL1
- 0-Verzögerung mit PLL1 oder PLL2
- Hochzuverlässig
- Gesteuerte Baseline
- Ein Montage- und Prüfstandort
- Eine Fertigungsstätte
- Längerer Produktlebenszyklus
- Erweiterte Produkt-Änderungsmitteilung
- Produktrückverfolgbarkeit
Applikationen
- Militär-Radar
- Elektronische Kriegsführung
- Datenwandler-Taktung
- Drahtlose Infrastruktur
Blockdiagramm
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