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LMK5C33414ARGCRS1

Name: Texas Instruments LMK5C33414ARGCRS1
Brand: Texas Instruments
SKU: 595-LMK5C33414ARGCRS
Price: 38.57 EUR
Availability: OutOfStock

Bilder dienen lediglich der Veranschaulichung und sind nicht Originalgetreu
Siehe Produktspezifikationen

Mouser-Nr.:

595-LMK5C33414ARGCRS

Herst.- Nr.:

LMK5C33414ARGCRS1

Herst.:

Texas Instruments

Beschreibung:

Clock-Synthesizer / Jitter-Reiniger Three DPLL three AP LL four-input and 1

Datenblatt:

LMK5C33414ARGCRS1 Datenblatt

ECAD Model:

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Hersteller:	Texas Instruments
Produktkategorie:	Clock-Synthesizer / Jitter-Reiniger
RoHS:
Anzahl der Ausgänge:	14 Output
Max. Ausgangsfrequenz:	1.25 GHz
Ausgangsstufe:	APLL
Eingabestufe:	DPLL
Verpackung/Gehäuse:	VQFN-64
Maximale Eingangsfrequenz:	800 MHz
Versorgungsspannung - Min.:	3.135 V
Versorgungsspannung - Max.:	3.465 V
Minimale Betriebstemperatur:	- 40 C
Maximale Betriebstemperatur:	+ 105 C
Serie:	LMK5C33414AS1
Montageart:	SMD/SMT
Verpackung:	Reel
Marke:	Texas Instruments
Land der Bestückung:	Not Available
Land der Verbreitung:	Not Available
Ursprungsland:	PH
Feuchtigkeitsempfindlich:	Yes
Betriebsversorgungsstrom:	1.085 A
Produkt:	Network Synthesizers / Jitter Cleaners
Produkt-Typ:	Clock Synthesizers / Jitter Cleaners
Verpackung ab Werk:	2500
Unterkategorie:	Clock & Timer ICs

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Datenblatt

LMK5C33414ARGCRS1 Datenblatt

PCN

Product Change Notification 2025-3-28 (PDF)

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USHTS:: 8542390090
ECCN:: EAR99

LMK5C33414AS1 Netzwerk-Synchronisierer

Der Network-Synchronisierer LMK5C33414AS1 von Texas Instruments ist ein Netzwerk-Synchronisierer und Jitter-Cleaner, der für die strengen Anforderungen von drahtlosen Kommunikations- und Infrastrukturanwendungen entwickelt wurde. Der LMK5C33414AS1 ist ein Bauteil mit Softwareunterstützung für die PTP-Synchronisierung gemäß IEEE-1588 mit einer primären Referenztaktquelle. Der Netzwerk-Synchronisierer integriert drei DPLLs, um Jitter-Dämpfung und fehlerloses Umschalten mit programmierbarer Schleifenbandbreite und ohne externe Schleifenfilter zu ermöglichen. Diese Funktion sorgt für maximale Benutzerfreundlichkeit und Flexibilität. Jede DPLL-Phase verbindet eine gepaarte APLL mit einem Referenzeingang.