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LS1020AXE7KQB

Name: NXP LS1020AXE7KQB
Brand: NXP Semiconductors
SKU: 841-LS1020AXE7KQB
Price: 59.16 EUR
Availability: InStock

Bilder dienen lediglich der Veranschaulichung und sind nicht Originalgetreu
Siehe Produktspezifikationen

Mouser-Nr.:

841-LS1020AXE7KQB

Herst.- Nr.:

LS1020AXE7KQB

Herst.:

NXP Semiconductors

Beschreibung:

Mikroprozessoren - MPU Layerscape 32-bit Arm Cortex-A7, Dual-core, 1.0GHz, -40 to 105C, Security enabled

Datenblatt:

LS1020AXE7KQB Datenblatt (PDF)

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	59,16 €	59,16 €
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Hersteller:	NXP
Produktkategorie:	Mikroprozessoren - MPU
Versandbeschränkungen:	Für den Export dieses Produkts aus den USA ist möglicherweise zusätzliche Dokumentation erforderlich.
RoHS:
Kern:	ARM Cortex A7
Anzahl der Kerne:	2 Core
Datenbus-Weite:	32 bit
Maximale Taktfrequenz:	1 GHz
Verpackung/Gehäuse:	FCPBGA-525
L1 Cache-Anweisungsspeicher:	32 kB
L1 Cache-Datenspeicher:	32 kB
Betriebsversorgungsspannung:	1 V
Serie:	LS1020A
Montageart:	SMD/SMT
Minimale Betriebstemperatur:	- 40 C
Maximale Betriebstemperatur:	+ 105 C
Verpackung:	Tray
Marke:	NXP Semiconductors
RAM-Datengröße:	128 kB
Anleitungsart:	Floating Point
Schnittstellen-Typ:	Audio, Ethernet, PCI-e, Serial, USB
L2 Cache-Anweisung/Datenspeicher:	512 kB
Speichertyp:	DDR3L / DDR4 SDRAM
Feuchtigkeitsempfindlich:	Yes
Anzahl der I/Os:	109 I/O
Anzahl der Timer/Zähler:	8 Timer
Prozessor-Serie:	QorIQ Layerscape LS1020A
Produkt-Typ:	Microprocessors - MPU
Verpackung ab Werk:	84
Unterkategorie:	Microprocessors - MPU
Handelsname:	QorIQ
Watchdog-Timer:	Watchdog Timer
Artikel # Aliases:	935316158557
Gewicht pro Stück:	1 g

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Datenblatt

LS1020AXE7KQB Datenblatt (PDF)

TARIC:: 8542319000
CNHTS:: 8542319091
CAHTS:: 8542310000
USHTS:: 8542310045
KRHTS:: 8542311000
MXHTS:: 8542310302
ECCN:: 5A002.a.1

Layerscape-Architektur

Die NXP Layerscape-Architektur ist die den QorIQ® Prozessoren der LS-Baureihe zugrundeliegende Systemarchitektur. Die Architektur ermöglicht den Netzwerken der nächsten Generation eine verbesserte Paketverarbeitung mit einer Leistungsfähigkeit von bis zu 100 GBit/s. Der Design-Aufwand wird mit einem offenen Standard-Programmiermodell und einem Software-wahrnehmenden Architektur-Rahmen vereinfacht. Dieses Design ermöglicht dem Kunden die vollständige Nutzung der zugrundeliegenden Hardware für eine maximale Optimierung mit der Fähigkeit, Netzwerk-Änderungen für eine Echtzeit-„Soft“-Steuerung über das Netzwerk einfach zu übernehmen. Ein einheitliches Hardware- und Software-Modell bietet die Kompatibilität und Skalierbarkeit, die für das Erstellen von durchgängigen Netzwerksystemen von Home-zu-Carrier-Klasse-Produkten erforderlich sind. Die einzigartige Core-unabhängige Architektur enthält den optimalen Core für die jeweilige Applikation/ARM®-Cores oder Power Architecture®-Cores.